vcs+verdi+uvm单步调试及问题记录

2023-12-18 09:12

本文主要是介绍vcs+verdi+uvm单步调试及问题记录,希望对大家解决编程问题提供一定的参考价值,需要的开发者们随着小编来一起学习吧!

编译

编译选项如下:

vcs -ntb_opts uvm -sverilog -f $PROJ_ROOT/tb/option.f -debug_access+all -kdb -lca -full64 -fsdb_old -timescale=1ns/10ps

其中最重要的是要加上这四项
-debug_access+all -kdb -lca -full64

option.f里面的内容如下,是一些verdi的文件选项:
在这里插入图片描述

仿真

仿真选项如下:

./simv -l run.log -gui=verdi

断点及uvm调试、问题记录

在instance里面可以直接找到tb里面的代码,可以直接打断点执行单步调试。
如图所示是一个很简单的driver,里面的变量a、b、c可以拉到watch里面,也可以新建不同的watch。
我在这里有个疑问,就是uvm debug里面的phase里面为什么没有找到driver中的main_phase?
在这里插入图片描述

这篇关于vcs+verdi+uvm单步调试及问题记录的文章就介绍到这儿,希望我们推荐的文章对编程师们有所帮助!



http://www.chinasem.cn/article/507859

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