孩子都能学会的FPGA：第三十三课——用FPGA实现一个通用的SPI主机接收模块

本文主要是介绍孩子都能学会的FPGA：第三十三课——用FPGA实现一个通用的SPI主机接收模块，希望对大家解决编程问题提供一定的参考价值，需要的开发者们随着小编来一起学习吧！

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上节课完成了通用SPI主机发送模块的FPGA设计，那本节课完成通用SPI主机接收模块的FPGA设计。

主机的接收模块是主机发送SCK和SS信号，同时解析从机发送的MISO信号，完成数据的解析。还是观察下面的图形，在CPHA=0时，在每个SCK的第一个跳变沿来采集MISO的数据；在CPHA=1时，在每个SCK的第二个跳变沿来采集MISO的数据。

根据上面的分析，我们开始FPGA程序的设计，接口信号如下所示。

其它信号的设计和SPI主机的发送模块基本一样，就是spi_state_cnt的计数值增加了FRE_DIV/2。该模块的shift_en信号和SPI主机发送模块正好差半个SCK时钟周期，通过shift_en信号完成从机MISO信号的接收和串并转换。

新建仿真文件，模拟SPI从机发送16位的随机数据，主机完成数据的接收。

如下所示，CPOL=0和CPHA=0，在SCK时钟的第一个变化沿采集MISO线上的数据，shift_en在SCK的上升沿使能，时序正确。

如下所示，CPOL=1和CPHA=0，在SCK时钟的第一个变化沿采集MISO线上的数据，shift_en在SCK的下降沿使能，时序正确。

如下所示，CPOL=0和CPHA=1，在SCK时钟的第二个变化沿采集MISO线上的数据，shift_en在SCK的下降沿使能，时序正确。

如下所示，CPOL=1和CPHA=1，在SCK时钟的第二个变化沿采集MISO线上的数据，shift_en在SCK的上降沿使能，时序正确。

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