利用Modelsim仿真出现报错解决方法Error (suppressible): (vsim-3009)

2023-10-23 22:10

本文主要是介绍利用Modelsim仿真出现报错解决方法Error (suppressible): (vsim-3009),希望对大家解决编程问题提供一定的参考价值,需要的开发者们随着小编来一起学习吧!

 程序没有报错,TestBench也没有报错

 在modelsim报错

Loading work.project_tb(fast)
# Loading work.project(fast)
# ** Error (suppressible): (vsim-3009) [TSCALE] - Module 'project' does not have a timeunit/timeprecision specification in effect, but other modules do.
#    Time: 0 ps  Iteration: 0  Instance: /project_tb/project_tb File: F:/FPGA/project/verilog TimeDelay/project.v
# Error loading design

解决方法

在源码的开头也加上

`timescale 1ns/1ps

 再次运行modelsim

 解决问题

这篇关于利用Modelsim仿真出现报错解决方法Error (suppressible): (vsim-3009)的文章就介绍到这儿,希望我们推荐的文章对编程师们有所帮助!



http://www.chinasem.cn/article/270752

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