本文主要是介绍Cadence Allegro（8）：生成网络报表（Netlist），希望对大家解决编程问题提供一定的参考价值，需要的开发者们随着小编来一起学习吧！
Cadence Allegro（8）：生成网络报表（Netlist）
前提摘要
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PCB设计软件版本：
- 原理图设计 ：Pad Designer 16.6
- PCB设计 ：PCB Editor 16.6
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个人说明：
限于时间紧迫以及作者水平有限，本文错误、疏漏之处恐不在少数，恳请读者批评指正。意见请留言或者发送邮件至：“noahpanzzz@gmail.com”
正文
在生成网络报表之前需要先检查：
- 检查原理图逻辑功能是否正确。
- 电气连接是否正确。
生成网络报表
- 选中工程文件(project.dsn)。
- Tools->Create Netlist
总结
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