ustc专题

Docker设置ustc的镜像源(镜像加速器:修改/etc/docker/daemon.json文件)

1、ustc简介 ustc是老牌的linux镜像服务提供者了,还在遥远的ubuntu 5.04版本的时候就在用。ustc的docker镜像加速器速度很快。ustc docker mirror的优势之一就是不需要注册,是真正的公共服务。 https://lug.ustc.edu.cn/wiki/mirrors/help/docker(Docker 镜像使用帮助文档) 2、设置ustc的镜像源

USTC ICS(2023Fall) Lab2 The PingPong Sequence

LC-3汇编语言 .ORIG x3000LDI R0,n ;f(n)NOT R0,R0ADD R0,R0,#1 ;取R0补码用于减法AND R1,R1,#0 ;R1记录循环次数,先初始化为0ADD R2,R1,#0 ;R2记录符号,加号为0,减号为-1,f(1)对应加号ADD R3,R1,#3 ;记录f(n),f(1)=3AND R5,R5,#0 ;R5存000

USTC ICS(2023Fall) Lab5 Password Verification

LC-3汇编语言 .orig x3000LOOP1 AND R1,R1,#0ADD R1,R1,#3LEA R0, string1PUTS ;打印string1AND R0,R0,#0ADD R0, R0, #10 OUT ;打印换行符GETCOUT;检查输入的字符是否为'W'(ASCII码为87)A

【USTC】verilog 习题练习 46-50

46 上升沿检测 题目描述 在实际应用中,我们经常需要对某个信号的边沿进行检测,并以此作为后续动作的触发信号(例如电脑键盘的某个按键被按下或者被松开,在电路中则对应的是电平的变化)。 设计一个电路,包含clk信号、1bit输入信号in和1bit输出信号out,当in信号从0变为1时(相对于clk,该信号变化频率很慢),out信号在in信号上升沿附近输出1个时钟周期的高电平脉冲,其余时刻都为0,

【USTC】verilog 习题练习 21-25

21 基于端口名称的实例化 题目描述 创建一 verilog 电路,实现对模块 mod_a 基于端口名称的实例化,如下图所示: 其中mod_a模块的代码为: module mod_a (output out1,output out2,input in1,input in2,input in3,input in4);assign out1 = in1 & in

icpc合肥(A-Welcome to USTC)

思路: 条件:标定字符串,保证其中有USTC且按顺序;问题:求将之合并最短代价;显然考虑中点,容易证明中点最小,min(ans) = x[4] - x[1] + x[3] - x[2] - 2 - 2;直接计算输出即可; 代码: #include<bits/stdc++.h>using namespace std;typedef long long ll;const int MAXN=

icpc合肥(A-Welcome to USTC)

思路: 条件:标定字符串,保证其中有USTC且按顺序;问题:求将之合并最短代价;显然考虑中点,容易证明中点最小,min(ans) = x[4] - x[1] + x[3] - x[2] - 2 - 2;直接计算输出即可; 代码: #include<bits/stdc++.h>using namespace std;typedef long long ll;const int MAXN=